一种HIMAC硬件协处理器的设计与FPGA实现

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为降低HINOC系统中CPU负荷,设计了一种HINOC MAC层的硬件加速协处理器,将部分软件功能采用硬件实现。设计采用硬件流分类机制及基于定长单元存储变长分组的队列管理方法,实现了各种业务流的快速分组、转发、调度等性能的明显提升。该设计通过了仿真及FPGA验证,实现了CPU、HIPHY及以太网之间数据的快速搬移处理。
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