基于FPGA与ARM的智能合并单元设计

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针对智能变电站信息数字化、功能集成化、结构紧凑化的要求,分析了IEC 60044-8、IEC 61850-9-1/2标准对合并单元的定义,在此基础上设计了一种基于现场可编程门阵列(field-programmable gate array,FPGA)与高级RISC微处理器(advanced RISC machines,ARM)的智能合并单元。辅处理器FPGA负责多路数据的同步接收,并集成逻辑判别机制软件实现母线的并列运行和切换;主处理器ARM负责FPGA的实时控制并将采样值按IEC 61850-9-2标准通过以太网发送,采用预配置采样值控制块实现采样值传输模型的灵活定义,避免了制造报文规范(manufacturing message specification,MMS)映射的实现困难。试验结果表明了设计方法的可行性和正确性。 According to the requirement of digitization, function integration and compact structure of intelligent substation information, the definition of merging unit according to IEC 60044-8 and IEC 61850-9-1 / 2 is analyzed. Based on this, a field programmable Smart combination of field-programmable gate array (FPGA) and advanced RISC machines (ARM). The secondary processor FPGA is responsible for the synchronous reception of multiple channels of data and integrates logic discrimination mechanism software to implement the parallel operation and switching of the buses. The primary processor ARM is responsible for the real-time control of the FPGA and sampling values ​​according to the standard of IEC 61850-9-2 via Ethernet Send, adopt the pre-configured sampling value control block to realize the flexible definition of the sampled value transmission model, and avoid the difficulty of manufacturing the message specification (MMS) mapping. The test results show that the design method is feasible and correct.
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