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提出了一种以任意字宽度对ＳＤＨ帧同步信号扰码／解扰的并行机制，解决了串行帧同步扰码器不适于高速信号处理的问题，并易于采用现场可编程门阵列ＦＰＧＡ实现。
并行SDH扰码器/解扰器的设计
【摘 要】
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提出了一种以任意字宽度对ＳＤＨ帧同步信号扰码／解扰的并行机制，解决了串行帧同步扰码器不适于高速信号处理的问题，并易于采用现场可编程门阵列ＦＰＧＡ实现。
【机 构】
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西安电子科技大学综合业务网理论及关键技术国家重点实验室
【出 处】
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西安电子科技大学学报
【发表日期】
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1997年3期
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