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基于FPGA的(2,1,9)Viterbi译码器的实现
基于FPGA的(2,1,9)Viterbi译码器的实现
来源 :福建电脑 | 被引量 : 0次 | 上传用户:errorli
【摘 要】
:
Viterbi算法是卷积码的一种最大似然译码。文中介绍了(2,1,9)的Viterbi译码器的FPGA一种实现方案,其中ACS运算采用两个基四蝶形运算、幸存路径采用单指针进行回溯、路径度量存
【作 者】
:
张红
【机 构】
:
福州大学物理与信息工程学院
【出 处】
:
福建电脑
【发表日期】
:
2009年8期
【关键词】
:
VITERBI译码器
幸存路径
路径度量
FPGA
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Viterbi算法是卷积码的一种最大似然译码。文中介绍了(2,1,9)的Viterbi译码器的FPGA一种实现方案,其中ACS运算采用两个基四蝶形运算、幸存路径采用单指针进行回溯、路径度量存储为乒乓结构,电路经过综合后输出速率最高能达到2.3Mbps。
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