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基于FPGA的并行FIR数字滤波器硬件实现及优化
基于FPGA的并行FIR数字滤波器硬件实现及优化
来源 :北京工商大学学报(自然科学版) | 被引量 : 0次 | 上传用户:xiaodong0814
【摘 要】
:
阐述了基于有限脉冲响应数字滤波器FIR的可编程逻辑器硬件实现的优化和改进方案.介绍了FIR滤波器原理及传统线性FIR滤波器的实现结构,提出了并行FIR滤波器的结构改进思路,详
【作 者】
:
付正
郑维智
江远志
【机 构】
:
北京工商大学机械工程学院
【出 处】
:
北京工商大学学报(自然科学版)
【发表日期】
:
2010年5期
【关键词】
:
现场可编程逻辑器件
硬件描述语言
Max-plusⅡ
有限脉冲响应数字滤波器
FPGA VHDL Max-Plus Ⅱ FIR
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阐述了基于有限脉冲响应数字滤波器FIR的可编程逻辑器硬件实现的优化和改进方案.介绍了FIR滤波器原理及传统线性FIR滤波器的实现结构,提出了并行FIR滤波器的结构改进思路,详细地说明了各模块具体功能的实现及采用技术,最后给出了并行FIR的拓展应用方案.
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