【摘 要】
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设计一种应用于锁相环(PLL)电路的压控振荡器(VCO).该电路采用浮空电容结构,相对传统接地电容结构,可提高电容充放电幅值,减小时钟抖动.快速电平检测电路,使电路在未采用反馈
【机 构】
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华侨大学信息科学与工程学院,厦门市ASIC与系统重点实验室
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设计一种应用于锁相环(PLL)电路的压控振荡器(VCO).该电路采用浮空电容结构,相对传统接地电容结构,可提高电容充放电幅值,减小时钟抖动.快速电平检测电路,使电路在未采用反馈和补偿的前提下,减小环路延时,从而实现高线性.电路采用CSMC0.6μmCMOS标准工艺库实现.仿真结果表明:振荡频率为0.79,24,30MHz时的相位噪声达到-128,-122,-120dBc·Hz-1@1MHz.通过调节外接电阻电容,使得电路在3~6V电源电压下,输出100.0~3.0×107MHz的矩形波
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