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通过设计实例详细介绍了用Verilog HDL语言开发FPGA/CPLD的方法,并通过与其他各种输入方式的比较,显示出使用Verilog HDL语言的优越性.
Verilog HDL语言在FPGA/CPLD开发中的应用
【摘 要】
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通过设计实例详细介绍了用Verilog HDL语言开发FPGA/CPLD的方法,并通过与其他各种输入方式的比较,显示出使用Verilog HDL语言的优越性.
【机 构】
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西南科技大学
【出 处】
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今日电子
【发表日期】
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2004年5期
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