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下一代高性能系统对带宽的需求越来越大。为满足这一需求,促使设计人员使用各种方法来优化其设计,提高时钟频率。虽然传统的FPGA内核体系结构支持这些优化,但是,所能够提高的频率有限。与传统的方法不同,Stratix10 FPGA和So C使用Hyper Flex新体系结构,内核时钟频率可达到前一代高性能FPGA的两倍。