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阐述了基于FPGA的数据压缩变速电路设计的总体思路，主要采用15位m序列作为被压缩数据。依据功能将系统分为16分频模块、控制模块、m序列产生模块、移位寄存器模块，整体生成采用MAX＋PLUSII的图形输入法，并利用FPAG芯片模拟其功能。
基于FPGA的数据压缩变速模拟研究
【摘 要】
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阐述了基于FPGA的数据压缩变速电路设计的总体思路，主要采用15位m序列作为被压缩数据。依据功能将系统分为16分频模块、控制模块、m序列产生模块、移位寄存器模块，整体生成采用
【机 构】
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丽水职业技术学院
【出 处】
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中国电子商务
【发表日期】
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2011年2期
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