VHDL语言设计可综合的微处理器内核

来源 :计算机应用研究 | 被引量 : 5次 | 上传用户：zhang760327

【摘要】

：

详细介绍了用VHDL语言设计可逻辑综合的教学实验用CPU的过程。CPU指令系统构架采用RISC结构 ,设计上使用结构化编程方法 ,将CPU内核按照功能划分为不同的模块 ,采用VHDL语言设计每一个模块的内部功能和外围接口。所有的功能模块组合起来后 ,通过EDA工具进行CPU内核的逻辑综合和功能仿真 ,最后在可编程逻辑器件上实现这个完整的CPU内核

【作者】

：

张楷汤志忠

【机构】

：

清华大学计算机科学与技术系

【出处】

：

计算机应用研究

【发表日期】

：

2004年06期

【关键词】

：

VHDL 微处理器逻辑综合 VHDL CPU Logic Synthesis

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