【摘 要】
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介绍了一种基于 ISA总线的高速数据采集系统构成及各部分功能。对提高高速数据采集系统的采样率和存储器带宽这两大技术难题提出了补救措施。采用交替采样合成方式实现了系统
【机 构】
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介绍了一种基于 ISA总线的高速数据采集系统构成及各部分功能。对提高高速数据采集系统的采样率和存储器带宽这两大技术难题提出了补救措施。采用交替采样合成方式实现了系统最高采样率的倍增 ;采用多体存储结构提高了系统存储带宽 ;利用复杂可编程控制逻辑 (CPL D)设计了系统控制逻辑、地址产生器、数据地址总线隔离器。文中最后给出了实际测试结果。
A high-speed data acquisition system based on ISA bus and its functions are introduced. To improve the high-speed data acquisition system sampling rate and memory bandwidth of these two technical problems proposed remedial measures. Multi-body memory structure is adopted to improve the system memory bandwidth. The system control logic, address generator, data address bus isolator are designed by CPL (Programmable Logic Control) . The article finally gives the actual test results.
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