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传统的数字逻辑设计内容一般基于SSI、MSI等标准规格芯片进行分析和设计，而且实验环节也是基于SSI、MSI的硬实验台，这种实验台不易做成开放性，实验准备和实验内容设计都不灵活，也受到SSI，MSI所供器件的限制。在“数字逻辑设计”的课程实验中，引进VHDL语言的方法，并且在实验环境上尝试把硬实验台逐步改变成软实验台环境。这种方案可完全克服硬实验台环境的不足，易于实现多媒体实验教学和网上实验教学。