HDTV集成解码芯片的一种总线设计

来源 :电路与系统学报 | 被引量 : 0次 | 上传用户：k60775

【摘要】

：

本文给出了HDTV集成解码芯片的一种总线设计方案.通过分割总线时间片静态调度DMA传输,并将部分HDTV解码同步控制嵌入到总线调度中,使总线数据传输与解码流程相配合,有效地分

【作者】

：

李东晓姚庆栋刘鹏周莉

【机构】

：

浙江大学

【出处】

：

电路与系统学报

【发表日期】

：

2003年3期

【关键词】

：

HDTV集成解码芯片总线仲裁时间片软硬件协同设计软硬件协同仿真 HDTV SoC decoder bus arbitration time slic

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本文给出了HDTV集成解码芯片的一种总线设计方案.通过分割总线时间片静态调度DMA传输,并将部分HDTV解码同步控制嵌入到总线调度中,使总线数据传输与解码流程相配合,有效地分配和使用总线带宽,在确保满足系统实时处理性能的条件下,尽可能降低系统对总线带宽的需求,减少片内数据缓冲区容量以降低系统硬件开销.

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