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一种复杂BIU的设计及其CPLD实现
一种复杂BIU的设计及其CPLD实现
来源 :计算机工程与应用 | 被引量 : 0次 | 上传用户:yangclio
【摘 要】
:
文章分析了可配置成多机系统的嵌入式微处理器中的总线接口单元的结构,文章产物首先详细分析了这种情况下总线接口单元的控制通路。然后从采用格雷方式FSM编码、FSM有效描述和
【作 者】
:
朱霞
高德远
等
【机 构】
:
西北工业大学769#航空微电子中心
【出 处】
:
计算机工程与应用
【发表日期】
:
2001年11期
【关键词】
:
嵌入式微处理器
总线接口单元
CPU
BIU
CPLD
Bus Interface Unit
CPLD
Finite State Machine(FSM)
on
【基金项目】
:
国防“九·五”预研项目资助!(编号:8.1.1.12、8.1.2.8、8.1.3.5)
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文章分析了可配置成多机系统的嵌入式微处理器中的总线接口单元的结构,文章产物首先详细分析了这种情况下总线接口单元的控制通路。然后从采用格雷方式FSM编码、FSM有效描述和接口信号的正确描述三个方面讨论该部件的高效实现。
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