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期刊论文
一种高速、低失真的采样保持电路
一种高速、低失真的采样保持电路
来源 :电路与系统学报 | 被引量 : 0次 | 上传用户:wdasheng
【摘 要】
:
本文设计了一种高速、低失真的开关电容采样保持电路,它采用了bootstrapped开关来降低非线性,并提出了减小放大器的建立时间的方法.结果表明其在40M的采样速度下,可以得到大
【作 者】
:
吴建辉
吴自信
吴宁
【机 构】
:
东南大学国家专用集成电路系统工程技术研究中心
【出 处】
:
电路与系统学报
【发表日期】
:
2004年4期
【关键词】
:
采样保持
非线性
总谐波失真
sample and hold
nonlinearity
total harmonic distortion
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本文设计了一种高速、低失真的开关电容采样保持电路,它采用了bootstrapped开关来降低非线性,并提出了减小放大器的建立时间的方法.结果表明其在40M的采样速度下,可以得到大于70dB的线性.
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