【摘 要】
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提出了一种采用逻辑工艺、访存速度优化、降低刷新功耗的动态随机存储器(DRAM),使其在嵌入式系统的设计与制造中易于与高性能逻辑电路融合.采用读写前置放大的高速读写方案,
【机 构】
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复旦大学专用集成电路与系统国家重点实验室
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提出了一种采用逻辑工艺、访存速度优化、降低刷新功耗的动态随机存储器(DRAM),使其在嵌入式系统的设计与制造中易于与高性能逻辑电路融合.采用读写前置放大的高速读写方案,使DRAM读写速度得到了优化;采用紧凑式电荷转移刷新替代传统刷新方案,在降低了刷新功耗的同时,缩短了DRAM的刷新时间开销,提高了DRAM的数据可访问性.仿真结果表明:与传统方案相比,在3ns时钟周期下,存储器写操作时间为3ns,减少了23%;数据访问时间为1.8ns,减少了15%;在刷新模式下,灵敏放大器功耗降低了58%,同时刷新时间降低了43%.
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