【摘 要】
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针对全数字接收机中位定时同步环定时恢复精度低、实现难度大等问题,提出了一种基于FPGA的高精度定时恢复内插间隔估计方法。该方法以系统主时钟作为基准进行内插间隔估计和
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针对全数字接收机中位定时同步环定时恢复精度低、实现难度大等问题,提出了一种基于FPGA的高精度定时恢复内插间隔估计方法。该方法以系统主时钟作为基准进行内插间隔估计和定时补偿,可获得低于系统主时钟的估计精度和恢复精度,且工程实现复杂度低、占用资源小、结构灵活性强,对于内插滤波器及内插定时误差估计算法不做特殊要求,具有较强的工程实现通用性。仿真结果表明,该方法具有更高的定时恢复精度。
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