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以CPLD为逻辑控制核心实现了ADS8323与高速FIFO的接口电路,该电路具有可靠性高、通用性强、易于移植等特点.在设计过程中,以QuartusⅡ作为开发环境,采用图形输入和Venlog HDL语言输入相结合的方式,简化了开发流程.
ADS8323与高速FIFO接口电路的CPLD实现
【摘 要】
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以CPLD为逻辑控制核心实现了ADS8323与高速FIFO的接口电路,该电路具有可靠性高、通用性强、易于移植等特点.在设计过程中,以QuartusⅡ作为开发环境,采用图形输入和Venlog HDL
【机 构】
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空军驻洛阳地区军事代表室,北京航空航天大学仪器科学与光电工程学院
【出 处】
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微计算机信息
【发表日期】
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2007年20期
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