【摘 要】
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采用带采样/保持电路,由10级1.5位每级级电路和最后一级为2位flash ADC组成的流水线结构,设计了一种12位60MHz高性能流水线模数转换器.在设计中采用栅压自举开关降低非线性,
【机 构】
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中国科学院微电子研究所,新一代通信射频芯片技术北京市重点实验室
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采用带采样/保持电路,由10级1.5位每级级电路和最后一级为2位flash ADC组成的流水线结构,设计了一种12位60MHz高性能流水线模数转换器.在设计中采用栅压自举开关降低非线性,采用带增益自举的折叠式共源共栅输入级和AB类输出级的运放,采用动态锁存比较器,同时逐级优化级电路中采样电容以及运放的增益和带宽.在SMIC 40nm CMOS工艺下,当输入信号为1.875 MHz,采样速率为60 MHz时,SNDR为68.7dB,SFDR为74.6dB,ENOB为11.12bit,芯片的核心面积为0.95
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