一种新颖的集成电路版图验证方法

来源 :微电子学 | 被引量 : 0次 | 上传用户：peihe_8873

【摘要】

：

版图验证是集成电路设计的瓶颈之一.文章全面系统地阐述了超大规模集成电路LVS版图验证的原理、方法和基本的流程,着重介绍了基于Dracula开发的CMOS、Bipolar和ABCD(Advanced

【作者】

：

汤炜林争辉朱以南肖世红

【机构】

：

上海交通大学

【出处】

：

微电子学

【发表日期】

：

2003年2期

【关键词】

：

超大规模集成电路版图验证 VLSI Dracula语言 LDMOS LVS工具 VLSI Layout versus schematic (LVS) Layo

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版图验证是集成电路设计的瓶颈之一.文章全面系统地阐述了超大规模集成电路LVS版图验证的原理、方法和基本的流程,着重介绍了基于Dracula开发的CMOS、Bipolar和ABCD(Advanced Bipolar CMOS DMOS)工艺的LVS命令文件,在解决以上工艺的电路LVS的过程中,取得了令人满意的效果.

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