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在适于采用内建自测方法进行可测性设计的电路中,累加器往往是一种被普遍采用的基本单元,如通用处理器和数字信号处理电路中的算术及逻辑运算电路.文章以Booth乘法器为例,介绍了利用累加器电路进行内建自测输出响应分析的几种常见形式,同时给出了相应的故障覆盖率、硬件开销和时延等方面的比较结果.
基于累加器的内建自测方法研究与分析
【摘 要】
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在适于采用内建自测方法进行可测性设计的电路中,累加器往往是一种被普遍采用的基本单元,如通用处理器和数字信号处理电路中的算术及逻辑运算电路.文章以Booth乘法器为例,介
【机 构】
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复旦大学专用集成电路与系统国家重点实验室
【出 处】
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微电子学与计算机
【发表日期】
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2003年11期
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