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介绍一种基于多片ADC的时间交替并行采样设计方法以及在FPGA平台上的实现。着重阐述TIADC并行采样的增益误差、时间误差校正算法及实现。实验结果表明,TIADC并行数据采集系统的结构设计和预处理算法,能较好抑制因相位偏移、时钟抖动等造成的非均匀误差。
基于FPGA的TIADC并行采样系统设计
【摘 要】
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介绍一种基于多片ADC的时间交替并行采样设计方法以及在FPGA平台上的实现。着重阐述TIADC并行采样的增益误差、时间误差校正算法及实现。实验结果表明,TIADC并行数据采集系统
【机 构】
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四川大学锦江学院
【出 处】
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电子测试
【发表日期】
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2017年1X期
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