【摘 要】
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The shuffle operations are the bottleneck when mapping the FFT-like algorithms to the vector SIMD architectures. We propose six（three pairs） innovative vector memory-access shuffle fused instructions,
【机 构】
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College of Computer, National University of Defense Technology
【基金项目】
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supported by the National Natural Science Foundation of China （NSFC）:Research on Efficient Parallel Storage Technology for Wide Vector Architecture DSP （No.61602493）； the National N
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The shuffle operations are the bottleneck when mapping the FFT-like algorithms to the vector SIMD architectures. We propose six（three pairs） innovative vector memory-access shuffle fused instructions,which have been proved mathematically. Together with the proposed modified binary-exchange method,the innovative instructions can efficiently address the bottleneck problem for DIF/DIT radix-2/4 FFT-like algorithms,reach a performance improvement by 17.9%～111.2% and reduce the code size by 5.4%～39.8%.Besides,the proposed instructions fit some hybrid-radix FFTs and are suitable for the terms of the initial or result data placement for general algorithms. The software and hardware cost of the proposed instructions is moderate.
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