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介绍一种高稳定度的基于锁相环技术的频率合成器的设计方法。它利用锁相环技术闭环锁定信号频率,同时使用CPT原子钟作为参考频率信号,使得系统的稳定度得以大幅度的提高。介绍了电路中环路滤波器和压控振荡器的设计方案。
PLL频率合成器设计与实现
【摘 要】
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介绍一种高稳定度的基于锁相环技术的频率合成器的设计方法。它利用锁相环技术闭环锁定信号频率,同时使用CPT原子钟作为参考频率信号,使得系统的稳定度得以大幅度的提高。介
【机 构】
：
江汉大学物理与信息工程学院
【出 处】
：
电子世界
【发表日期】
：
2016年5期
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