基于FPGA的五级流水线CPU

来源 :计算机系统应用 | 被引量 : 0次 | 上传用户：yanmu1984

【摘要】

：

基于FPGA平台设计并实现了一种五级流水线CPU.它参考MIPS机将指令的执行过程进行抽象,把指令分成取值、译码、执行、访存、写回五级流水处理.首先设计系统级的结构,决定CPU的

【作者】

：

王绍坤

【机构】

：

北京理工大学计算机学院

【出处】

：

计算机系统应用

【发表日期】

：

2015年3期

【关键词】

：

VHDL FPGA 流水线CPU VHDL FPGA pipeline CPU

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基于FPGA平台设计并实现了一种五级流水线CPU.它参考MIPS机将指令的执行过程进行抽象,把指令分成取值、译码、执行、访存、写回五级流水处理.首先设计系统级的结构,决定CPU的结构和指令系统.其次对整体结构进行分解,确定模块与模块之间的信号连接,采用VHDL实现CPU.最后通过Debug-controller调试软件对五级流水线CPU进行调试.结果表明了所设计的流水线CPU的有效性.

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