组合逻辑电路设计基础(二)

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这是因为一般门电路结构如图3.8(b)所示.设某一时刻V01=VoH,V02=VoL,即门1中G1导通,G2截止;门2中G1截止,G2导通.由于输出端V01、V02连接在一起,必将有电流I从+VCC(VDD)经门1中G1、门2中G2至⊥.由于G1、G2饱和压降很小,所以该电流I很大,将烧毁G1或G2.
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