【摘 要】
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基于55 nm CMOS工艺,设计了一种工作速率为2.5 Gbit/s的高灵敏度跨阻放大器(TIA).TIA输入级电路采用三级反相器级联结构.为了提高动态范围,采用了双自动控制增益(AGC)电路来
【机 构】
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武汉大学物理科学与技术学院,武汉,430072;武汉飞思灵微电子技术有限公司,武汉,430200
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基于55 nm CMOS工艺,设计了一种工作速率为2.5 Gbit/s的高灵敏度跨阻放大器(TIA).TIA输入级电路采用三级反相器级联结构.为了提高动态范围,采用了双自动控制增益(AGC)电路来调节反馈电阻阻值.输入级电路后级的三级差分放大器进一步放大电压信号,并运用有源电感峰化技术来提高带宽,最后进行缓冲器输出.为了降低跨阻放大器的噪声,设计了基准带隙电路和电压偏置电路,采用温度补偿技术来保证芯片的温度稳定性.电路仿真结果表明,在误码率BER=1×10-12情况下,TIA的后仿真灵敏度为-30.2 dBm,跨阻增益为87.5 dBΩ,带宽为1.8 GHz.在3.3V电压的条件下,功耗为119.4 mW.
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