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随着集成电路系统的规模和复杂性的不断提高,基于IP核的SOC系统的设计已被广泛采用.与此同时,电路测试的难度不断增大,对电路的可测性设计也提出了更高的要求.文章介绍了应用于嵌入式系统的16位时钟控制器(Timer Control Unit)的IP核设计,设计中采用了JTAG可测性设计电路.
一种适合SOC的时钟控制器IP核
【摘 要】
：
随着集成电路系统的规模和复杂性的不断提高,基于IP核的SOC系统的设计已被广泛采用.与此同时,电路测试的难度不断增大,对电路的可测性设计也提出了更高的要求.文章介绍了应用
【机 构】
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复旦大学
【出 处】
：
微电子学
【发表日期】
：
2003年6期
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