【摘 要】
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【正】当FPGA设计无法满足时序性能目标时,其原因可能并不明显。解决方案不仅取决于FPGA实现工具为满足时序要求而优化设计的能力,还取决于设计人员指定前方目标,诊断并隔离
【机 构】
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Synopsys公司FPGA产品部,Synopsys公司
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【正】当FPGA设计无法满足时序性能目标时,其原因可能并不明显。解决方案不仅取决于FPGA实现工具为满足时序要求而优化设计的能力,还取决于设计人员指定前方目标,诊断并隔离下游时序问题的能力。目前,设计人员掌握了一些使用技巧,可以帮助您设置时钟。通过Synopsys Synplify Premier等工具正确设置时序约束,然后调整参数,以满足赛灵思FPGA设计的性能目标。
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