【摘 要】
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针对可配置LDPC译码器,提出了一种低复杂度的移位网络结构,明显降低了硬件实现的复杂度。基于结构化LDPC译码器的两个特点:输入端的个数是一个常数的倍数、所有移位都是循环
【机 构】
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哈尔滨工业大学深圳研究生院网络智能计算重点实验室,华为技术有限公司,
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针对可配置LDPC译码器,提出了一种低复杂度的移位网络结构,明显降低了硬件实现的复杂度。基于结构化LDPC译码器的两个特点:输入端的个数是一个常数的倍数、所有移位都是循环移位,提出易于实现且延迟很小的移位网络控制信号生成算法。此外,针对IEEE 802.16e标准的LDPC译码器,设计了采用这种结构的移位电路。基于SMIC 130nm工艺进行仿真,综合结果表明,该电路占用的芯片面积为0.11mm2,最高频率为430MHz。
Aiming at the configurable LDPC decoder, a low complexity shift network structure is proposed, which obviously reduces the complexity of hardware implementation. Based on two characteristics of structured LDPC decoder: the number of input terminals is a multiple of a constant, all shifts are cyclic shifts, and a shift network control signal generation algorithm which is easy to implement and has little delay is proposed. In addition, for the IEEE 802.16e standard LDPC decoder, a shift circuit using this structure is designed. Based on SMIC 130nm process simulation, the comprehensive results show that the chip occupies a chip area of 0.11mm2, the maximum frequency of 430MHz.
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