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期刊论文
直扩解调器锁相环设计
直扩解调器锁相环设计
来源 :电子科技 | 被引量 : 0次 | 上传用户:shengyan1205
【摘 要】
:
在大多普勒频移与低信噪比的通信环境下,为了实现直扩解调器中的载波提取,建立了载波同步模型,重点对其中的锁相环进行环路参数设计,并通过仿真比较了在不同信噪比下,锁相环环路参
【作 者】
:
邬婕鸣
张辉
强晔
【机 构】
:
西安电子科技大学通信工程学院
【出 处】
:
电子科技
【发表日期】
:
2008年5期
【关键词】
:
锁相环
多谱勒频移
低信噪比
直扩解调器
phase-locked loop (PLL)
Doppler frequency offset
low SNR
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在大多普勒频移与低信噪比的通信环境下,为了实现直扩解调器中的载波提取,建立了载波同步模型,重点对其中的锁相环进行环路参数设计,并通过仿真比较了在不同信噪比下,锁相环环路参数对系统的捕获时间以及跟踪精度等性能的影响,对结果进行分析并得出结论。
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