【摘 要】
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在高速数据采集系统中,对于高速数据流的接收的可靠性,是整个系统正常工作的前提与保证。在基于FPGA＋DSP架构的高速数据采集系统中,由于FPGA布局布线、环境温度、工作电压的变
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在高速数据采集系统中,对于高速数据流的接收的可靠性,是整个系统正常工作的前提与保证。在基于FPGA＋DSP架构的高速数据采集系统中,由于FPGA布局布线、环境温度、工作电压的变化等各方面的影响,可能造成数据同步时钟与数据对应关系的偏移,由此而可能造成高速数据流接收的不可靠。针对以上问题,基于DPA（dynamic phase alignment,动态相位调整）的设计思想,提出一种高速数据流接收的校正方法,并在FPGA＋DSP架构的高速数据采集系统上设计实现,使得数据同步时钟的时钟沿与数据的有效窗口的最佳采
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