【摘 要】
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为了解决SPI协议中串行时钟的通用性问题,提出了一种基于FPGA实现SPI总线IP核的设计方法。以FPGA作为核心控制器对系统结构进行了模块化分解以适应自顶向下的设计方法并对各
【机 构】
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地质灾害防治与地质环境保护国家重点实验室,西南科技大学
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为了解决SPI协议中串行时钟的通用性问题,提出了一种基于FPGA实现SPI总线IP核的设计方法。以FPGA作为核心控制器对系统结构进行了模块化分解以适应自顶向下的设计方法并对各个模块进行阐述。在Quartus II开发平台中采用Verilog硬件描述语言利用有限状态机实现了SPI主机的设计方法并结合SPI时序给出了相应的数学模型。采用STMicro公司的M25P64串行FLASH结合该IP核设计了系统方案。最后在Modelsim环境下对FLASH的读、写操作进行仿真,并通过signaltap进行在线测试验证了该IP核设计的正确性和可靠性。
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