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千兆以太网卡芯片时钟产生电路的设计与实现
千兆以太网卡芯片时钟产生电路的设计与实现
来源 :电子设计应用 | 被引量 : 0次 | 上传用户:qiming1155
【摘 要】
:
本文介绍了千兆以太网卡芯片时钟产生电路的设计,包括体系结构设计、系统设计与仿真、电路设计与仿真,及版图设计.该时钟产生电路的工作电压为1.5V,经过TSMC 0.13μm 1P8M CM
【作 者】
:
朱全庆
张道礼
李海华
【机 构】
:
华中科技大学电子科学与技术系,东华大学理学院
【出 处】
:
电子设计应用
【发表日期】
:
2005年9期
【关键词】
:
锁相环
电荷泵
压控振荡器
时钟产生电路
以太网卡芯片
体系结构设计
系统设计
电路设计
版图设计
工作电压
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本文介绍了千兆以太网卡芯片时钟产生电路的设计,包括体系结构设计、系统设计与仿真、电路设计与仿真,及版图设计.该时钟产生电路的工作电压为1.5V,经过TSMC 0.13μm 1P8M CMOS工艺验证,表明该电路能够满足千兆以太网卡芯片的要求.
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