【摘 要】
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本文介绍了一种基于32位整数单元的片上cache存储体系结构设计的方案。作为SOC平台的核心部件,本设计中所有模块均自行设计,采用自顶向下的设计方法,应用Verilog HDL硬件描述
【机 构】
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黑龙江大学电子工程学院,哈尔滨工业大学微电子中心 哈尔滨150080,哈尔滨150001
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本文介绍了一种基于32位整数单元的片上cache存储体系结构设计的方案。作为SOC平台的核心部件,本设计中所有模块均自行设计,采用自顶向下的设计方法,应用Verilog HDL硬件描述语言进行设计,总线接口符合AMBATM总线规范(Rev 2.0)。为了对设计功能的有效性进行验证,还设计了一个基于AMBATM总线协议的通用SOC的系统虚拟验证平台,利用该平台对相关模型进行了调试和仿真。仿真结果表明,设计达到预期的功能要求。
This article describes a 32-bit integer-based on-chip cache memory architecture design program. As the core part of the SOC platform, all the modules in this design are designed by themselves. They are designed with a top-down design using the Verilog HDL hardware description language. The bus interface complies with the AMBATM bus specification (Rev 2.0). In order to validate the design function, a universal SOC system virtual verification platform based on AMBATM bus protocol is also designed. The platform is used to debug and simulate the related model. Simulation results show that the design meets the expected functional requirements.
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