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基于VHDL语言的数字频率计的设计与仿真
基于VHDL语言的数字频率计的设计与仿真
来源 :河南工程学院学报(自然科学版) | 被引量 : 0次 | 上传用户:chimaomao
【摘 要】
:
介绍了一种采用VHDL语言设计数字频率计的方法,利用测周法和测频法相结合的原理,对传统的频率计进行了改进,实现了0Hz-1MHz的频率测量范围,并且给出了仿真结果.仿真结果表明,该频率
【作 者】
:
董秀洁
杨艳
【机 构】
:
中原工学院电子信息学院
【出 处】
:
河南工程学院学报(自然科学版)
【发表日期】
:
2008年4期
【关键词】
:
数字频率计
测周法
测频法
VHDL
【基金项目】
:
河南省教育厅自然科学研究资助项目(200410465101201,200510465002)
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介绍了一种采用VHDL语言设计数字频率计的方法,利用测周法和测频法相结合的原理,对传统的频率计进行了改进,实现了0Hz-1MHz的频率测量范围,并且给出了仿真结果.仿真结果表明,该频率计具有体积小、测量精度高、可靠性好等特点,同时可以通过修改程序达到扩大测量范围的目的.
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