【摘 要】
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针对如何使用硬件实现三角形光栅化，提高三角形光栅化速度，提出一种集裁减与填充于一体的三角形光栅化算法。在算法中扫描与采样算法相互独立，可以根据不同应用替换相应的采样算
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针对如何使用硬件实现三角形光栅化，提高三角形光栅化速度，提出一种集裁减与填充于一体的三角形光栅化算法。在算法中扫描与采样算法相互独立，可以根据不同应用替换相应的采样算法。使用基于Xilinx Virtex 2P XC2VP30的FPGA平台的硬件方法实现了该算法。实验结果表明，在FPGA板上实际运行时，约2500ns,就可以光栅化一个边长为5像素的等边三角形。
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