【摘 要】
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针对具有准循环结构的LDPC码，设计了一种低复杂度译码器。利用校验矩阵的循环特性以及分层迭代的译码算法，对一般的分层迭代架构进行改进，实现了译码器流水线处理，有效的减少迭代
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针对具有准循环结构的LDPC码，设计了一种低复杂度译码器。利用校验矩阵的循环特性以及分层迭代的译码算法，对一般的分层迭代架构进行改进，实现了译码器流水线处理，有效的减少迭代时间，提高吞吐量，最后针对码长为1200的LDPC码，基于FPGA平台Kintex7 xc7k325的芯片实现了该架构设计，结果表明，该译码器只消耗了100多个Slices和几块RAM，有效节省了硬件资源,同时译码时间比一般的分层架构减少了2／3左右。吞吐量提高了约2倍，研究成果具有重要的实用价值，可应用于资源有限的低速通信领域。
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ue＊M＃’＃dkB4＃＃8＃”专利申请号:00109“7公开号:1278062申请日:00.06.23公开日:00.12.27申请人地址:（100084川C京市海淀区清华园申请人:清华大学发明人:隋森芳文摘:本发明属于生物技