嵌入式协处理器中除法和平方根计算的整合设计

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在浮点处理元中串行实现除法和平方根计算虽然速度慢,但设计简单规则,占用资源少,有利于嵌入式的应用.结合嵌入式协处理器LSC87的研制,给出了串行实现除法和平方根计算的基4 SRT算法,介绍了确定SRT选择常数过程中不确定区域的验证方法;给出了除法与平方根计算可共用的基4 SRT查询表设计;同时讨论了迭代冗余结果向非冗余二进制的转换.本协处理器设计最大限度地利用了通用数据路径来完成SRT算法的实现,节约了设计资源,并缩短了迭代时间.
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