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要在具体的器件(如FPGA)上实现警管算法,不仅要考虑到算法的正确性和高效性,还要注意可实现性。详细介绍了一种用在AFDX网络的高效、低逻辑资源占用的基于虚拟计时的警管算法,分析了资源占用情况及需要关注的几个问题。该算法已经在Altera公司的FPGA上实现,而且可以推广到其他网络。
AFDX网络中基于虚拟计时的警管算法
【摘 要】
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要在具体的器件(如FPGA)上实现警管算法,不仅要考虑到算法的正确性和高效性,还要注意可实现性。详细介绍了一种用在AFDX网络的高效、低逻辑资源占用的基于虚拟计时的警管算法,分析了资源占用情况及需要关注的几个问题。该算法已经在Altera公司的FPGA上实现,而且可以推广到其他网络。
【机 构】
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西安电子科技大学通信工程学院
【出 处】
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计算机应用
【发表日期】
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2008年12期
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