一种双核SoC调试系统的设计与验证

来源 :电子与封装 | 被引量 : 0次 | 上传用户：chanstan

【摘要】

：

调试系统的设计和验证是多核SoC设计中的重要环节。基于某双核SoC的设计，提出一个片上硬件调试构架，利用FPGA构建该调试系统的硬件验证平台。双核SoC调试系统验证平台利用Syste

【作者】

：

虞致国魏敬和

【机构】

：

中国电子科技集团公司第58研究所

【出处】

：

电子与封装

【发表日期】

：

2010年1期

【关键词】

：

双核调试系统 SystemVerilog直接编程接口虚拟验证平台 JTAG dual-core debug system system verilog DP

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调试系统的设计和验证是多核SoC设计中的重要环节。基于某双核SoC的设计，提出一个片上硬件调试构架，利用FPGA构建该调试系统的硬件验证平台。双核SoC调试系统验证平台利用SystemVerilogDPI，将RealView调试器、KeilC51及目标芯片的验证testbench集成在一起，实现了双核SoC调试系统的RTL级调试验证。利用该平台，在RTL仿真验证阶段可方便地对ARM和8051核构成的双核SoC进行调试，解决仿真中出现的问题，从而有效缩短设计周期，并提高验证效率。该双核SOC调试系统验证平台

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