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期刊论文
基于VHDL等精度频率计的设计
基于VHDL等精度频率计的设计
来源 :福建电脑 | 被引量 : 0次 | 上传用户:helloliuhh
【摘 要】
:
本文利用等精度测量原理,通过EDA技术运用VHDL编程设计一个频率计.精度范围在0.1-100MHz,给出实现代码和仿真波形,基于VHDL等精度频率计设计具有较高的实用性和可靠性。
【作 者】
:
李攀
魏楠
【机 构】
:
济源职业技术学院信息工程系
【出 处】
:
福建电脑
【发表日期】
:
2012年4期
【关键词】
:
VHDL
等精度
FPGA
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本文利用等精度测量原理,通过EDA技术运用VHDL编程设计一个频率计.精度范围在0.1-100MHz,给出实现代码和仿真波形,基于VHDL等精度频率计设计具有较高的实用性和可靠性。
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