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节省大小比较中的逻辑电路Ｃｙｐｒｅｓｓ Ｓｅｍｉｃｏｎｄｕｃｔｏｒ公司Ｃｈｒｉｓ Ｊｏｎｅｓ设计人员常常要进行可编程逻辑器件的大小比较，以完成地址译码。他们要求乘积项数随着待比较的位数的增加而呈指数增大，但是，现在有一种诀窍控制一个ＣＰＬＤ内所需的资...
节省大小比较中的逻辑电路
【摘 要】
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节省大小比较中的逻辑电路Ｃｙｐｒｅｓｓ Ｓｅｍｉｃｏｎｄｕｃｔｏｒ公司Ｃｈｒｉｓ Ｊｏｎｅｓ设计人员常常要进行可编程逻辑器件的大小比较，以完成地址译码。他们要求乘积项数随着待比较的位数的增加而呈指数增大，但是，现在有一种诀窍控
【出 处】
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电子产品世界
【发表日期】
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1996年2期
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