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在传统的Turbo译码算法Log—MAP的基础上,对译码算法和SISO译码模块进行了优化,得到了改进的SW—Log—MAP算法.它在保证译码性能的前提下,大大降低了其运算复杂度,减少了存储空间。并且给出了改进译码算法硬件实现的设计方案,完成了Turb0译码器的FPGA实现,通过测试证明,译码器达到了设计要求。