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本文介绍了一款RISC_CPU的可测性设计，为了提高芯片的可测性，采用了扫描设计和存储器内建自测试，这些技术的使用为该芯片提供了方便可靠的测试方案。
8位RISC_CPU可测性设计
【摘 要】
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本文介绍了一款RISC_CPU的可测性设计，为了提高芯片的可测性，采用了扫描设计和存储器内建自测试，这些技术的使用为该芯片提供了方便可靠的测试方案。
【机 构】
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江南大学信息工程学院,立信职教中心校,中国电子科技集团第58研究所
【出 处】
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微计算机信息
【发表日期】
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2009年5期
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