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介绍了VXI总线从模块时序控制器的动作过程及其特点,并基于VHDL硬件描述语言,用异步MEALY状态机的方法进行VXI总线寄存器基接口的时序控制器的设计.
VXI总线从模块时序控制器的VHDL语言设计
【摘 要】
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介绍了VXI总线从模块时序控制器的动作过程及其特点,并基于VHDL硬件描述语言,用异步MEALY状态机的方法进行VXI总线寄存器基接口的时序控制器的设计.
【机 构】
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北京化工大学信息科学与技术学院
【出 处】
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北京化工大学学报(自然科学版)
【发表日期】
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2002年6期
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