可演化组合逻辑数字电路的静电放电抗扰特性

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随着科技飞速发展,集成电路工艺以及设计技术日渐完善,数字电路系统日渐复杂化,电磁敏感度不断提高。同时,电磁环境复杂多变,静电放电频繁出现,电力系统电磁环境效应大幅度强化,需要优化利用可靠性较高的容错技术、抗扰技术等,最大化提高电力系统的安全性、可靠性,实现最大化的运营效益。本文多角度客观分析了可演化组合逻辑数字电路系统设计,多层次探讨了可演化组合逻辑数字电路多目标演化算法,静电放电抗扰特性实验以及静电放电防护。
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