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异构多核处理器分支预测器研究与设计
异构多核处理器分支预测器研究与设计
来源 :微电子学与计算机 | 被引量 : 0次 | 上传用户:liyqi
【摘 要】
:
为解决单核处理器时钟频率难以提高、处理器功耗逐渐增加等问题,文中提出了一种新型异构多核处理器的设计方案.该结构中增加了B--Cache结构和C--Core控制器,这种新型异构多核处
【作 者】
:
金玉苹
焦平
佟阳
【机 构】
:
牡丹江师范学院数学系,哈尔滨工程大学计算机科学与技术学院
【出 处】
:
微电子学与计算机
【发表日期】
:
2011年11期
【关键词】
:
异构多核处理器
B--Cache
动态指令发射
CMP
B-Cache
dynamic instruction issue
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为解决单核处理器时钟频率难以提高、处理器功耗逐渐增加等问题,文中提出了一种新型异构多核处理器的设计方案.该结构中增加了B--Cache结构和C--Core控制器,这种新型异构多核处理器避免了流水线因分支预测失误而flush,提高了整个处理器执行效率.
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