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基于VHDL的HDB3译码器的设计与实现
基于VHDL的HDB3译码器的设计与实现
来源 :茂名学院学报 | 被引量 : 0次 | 上传用户:gl24334119
【摘 要】
:
通过对HDB3码的特殊性分析,在进行编码时引用计数器来计算两个V之间1的个数,经过4个码元后,开始判断是否插B,同时采用双向码解决了插V难的问题。最后,采用VHDL语言在Max+plus
【作 者】
:
弓云峰
【机 构】
:
茂名学院计算机与电子信息学院
【出 处】
:
茂名学院学报
【发表日期】
:
2009年04期
【关键词】
:
HDB3码
VHDL语言
建模
编码
仿真
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通过对HDB3码的特殊性分析,在进行编码时引用计数器来计算两个V之间1的个数,经过4个码元后,开始判断是否插B,同时采用双向码解决了插V难的问题。最后,采用VHDL语言在Max+plusⅡ中实现了HDB3码的编码。
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