适用于SAR ADC的CMOS比较器的设计

来源 :电子设计应用 | 被引量 : 0次 | 上传用户：yilongfengyue5656

【摘要】

：

本文提出一种带时钟控制的CMOS比较器结构，它由两级前置差分放大器和一级带有正反馈的NMOS锁存器组成。此设计在前置预放和锁存器级联的基础上，引入了交叉耦合负载，复位、钳位技

【作者】

：

裴晓敏

【机构】

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襄樊学院物电系

【出处】

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电子设计应用

【发表日期】

：

2008年7期

【关键词】

：

正反馈比较器前置预放锁存器

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本文提出一种带时钟控制的CMOS比较器结构，它由两级前置差分放大器和一级带有正反馈的NMOS锁存器组成。此设计在前置预放和锁存器级联的基础上，引入了交叉耦合负载，复位、钳位技术，获得了高精度和较低的功耗。设计采用0.18μm CMOS工艺，电源电压为3．3V，分辨率为0．8mV，获得12bit的精度，可以应用于SAR ADC等模将格揍器市路中

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